P89LPC932A1FDH View Datasheet(PDF) - NXP Semiconductors.
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P89LPC932A1FDH
NXP Semiconductors.
P89LPC932A1FDH Datasheet PDF : 64 Pages
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NXP Semiconductors
P89LPC932A1
8-bit microcontroller with accelerated two-clock 80C51 core
17. Contents
1
General description . . . . . . . . . . . . . . . . . . . . . . 1
2
Features . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 1
2.1
Principal features . . . . . . . . . . . . . . . . . . . . . . . 1
2.2
Additional features . . . . . . . . . . . . . . . . . . . . . . 1
2.3
Comparison to the P89LPC932 . . . . . . . . . . . . 2
3
Ordering information . . . . . . . . . . . . . . . . . . . . . 3
4
Block diagram . . . . . . . . . . . . . . . . . . . . . . . . . . 4
5
Functional diagram . . . . . . . . . . . . . . . . . . . . . . 5
6
Pinning information . . . . . . . . . . . . . . . . . . . . . . 5
6.1
Pinning . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 5
6.2
Pin description . . . . . . . . . . . . . . . . . . . . . . . . . 7
7
Functional description . . . . . . . . . . . . . . . . . . 11
7.1
7.2
7.3
7.3.1
7.3.2
7.3.3
7.3.4
7.3.5
7.3.6
7.4
7.5
7.6
7.7
7.8
7.9
7.10
7.11
7.12
7.12.1
7.13
7.13.1
7.13.1.1
7.13.1.2
7.13.1.3
7.13.1.4
7.13.2
7.13.3
7.14
7.14.1
7.14.2
7.15
7.15.1
7.15.2
7.15.3
7.16
Special function registers . . . . . . . . . . . . . . . . 11
Enhanced CPU . . . . . . . . . . . . . . . . . . . . . . . . 17
Clocks . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 17
Clock definitions . . . . . . . . . . . . . . . . . . . . . . . 17
CPU clock (OSCCLK). . . . . . . . . . . . . . . . . . . 17
Low speed oscillator option . . . . . . . . . . . . . . 17
Medium speed oscillator option . . . . . . . . . . . 17
High speed oscillator option . . . . . . . . . . . . . . 17
Clock output . . . . . . . . . . . . . . . . . . . . . . . . . . 17
On-chip RC oscillator option . . . . . . . . . . . . . . 18
Watchdog oscillator option . . . . . . . . . . . . . . . 18
External clock input option . . . . . . . . . . . . . . . 18
CCLK wake-up delay . . . . . . . . . . . . . . . . . . . 19
CCLK modification: DIVM register . . . . . . . . . 19
Low power select . . . . . . . . . . . . . . . . . . . . . . 19
Memory organization . . . . . . . . . . . . . . . . . . . 19
Data RAM arrangement . . . . . . . . . . . . . . . . . 20
Interrupts . . . . . . . . . . . . . . . . . . . . . . . . . . . . 20
External interrupt inputs . . . . . . . . . . . . . . . . . 20
I/O ports . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 21
Port configurations . . . . . . . . . . . . . . . . . . . . . 22
Quasi-bidirectional output configuration . . . . . 22
Open-drain output configuration . . . . . . . . . . . 22
Input-only configuration . . . . . . . . . . . . . . . . . 22
Push-pull output configuration . . . . . . . . . . . . 23
Port 0 analog functions . . . . . . . . . . . . . . . . . . 23
Additional port features. . . . . . . . . . . . . . . . . . 23
Power monitoring functions. . . . . . . . . . . . . . . 23
Brownout detection . . . . . . . . . . . . . . . . . . . . . 23
Power-on detection . . . . . . . . . . . . . . . . . . . . . 24
Power reduction modes . . . . . . . . . . . . . . . . . 24
Idle mode . . . . . . . . . . . . . . . . . . . . . . . . . . . . 24
Power-down mode . . . . . . . . . . . . . . . . . . . . . 24
Total Power-down mode . . . . . . . . . . . . . . . . . 24
Reset . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 24
7.16.1
7.17
7.17.1
7.17.2
7.17.3
7.17.4
7.17.5
7.17.6
7.18
7.19
7.19.1
7.19.2
7.19.3
7.19.4
7.19.5
7.19.6
7.19.7
7.19.8
7.19.9
7.20
7.20.1
7.20.2
7.20.3
7.20.4
7.20.5
7.20.6
7.20.7
7.20.8
7.20.9
7.20.10
7.21
7.22
7.22.1
7.23
7.23.1
7.23.2
7.23.3
7.24
7.25
7.26
7.26.1
7.26.2
7.27
7.28
7.28.1
7.28.2
Reset vector . . . . . . . . . . . . . . . . . . . . . . . . . . 25
Timers/counters 0 and 1 . . . . . . . . . . . . . . . . 25
Mode 0 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 25
Mode 1 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 26
Mode 2 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 26
Mode 3 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 26
Mode 6 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 26
Timer overflow toggle output . . . . . . . . . . . . . 26
RTC/system timer. . . . . . . . . . . . . . . . . . . . . . 26
CCU . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 27
CCU clock . . . . . . . . . . . . . . . . . . . . . . . . . . . 27
CCUCLK prescaling . . . . . . . . . . . . . . . . . . . . 27
Basic timer operation . . . . . . . . . . . . . . . . . . . 27
Output compare . . . . . . . . . . . . . . . . . . . . . . . 27
Input capture . . . . . . . . . . . . . . . . . . . . . . . . . 27
PWM operation . . . . . . . . . . . . . . . . . . . . . . . 28
Alternating output mode . . . . . . . . . . . . . . . . . 29
PLL operation. . . . . . . . . . . . . . . . . . . . . . . . . 29
CCU interrupts . . . . . . . . . . . . . . . . . . . . . . . . 30
UART . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 30
Mode 0 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 30
Mode 1 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 30
Mode 2 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 31
Mode 3 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 31
Baud rate generator and selection . . . . . . . . . 31
Framing error . . . . . . . . . . . . . . . . . . . . . . . . . 31
Break detect . . . . . . . . . . . . . . . . . . . . . . . . . . 31
Double buffering . . . . . . . . . . . . . . . . . . . . . . . 32
Transmit interrupts with double buffering
enabled (modes 1, 2 and 3) . . . . . . . . . . . . . . 32
The 9th bit (bit 8) in double buffering
(modes 1, 2 and 3) . . . . . . . . . . . . . . . . . . . . . 32
I2C-bus serial interface. . . . . . . . . . . . . . . . . . 33
Serial Peripheral Interface (SPI). . . . . . . . . . . 35
Typical SPI configurations . . . . . . . . . . . . . . . 36
Analog comparators . . . . . . . . . . . . . . . . . . . . 38
Internal reference voltage. . . . . . . . . . . . . . . . 38
Comparator interrupt . . . . . . . . . . . . . . . . . . . 38
Comparators and power reduction modes . . . 39
Keypad interrupt . . . . . . . . . . . . . . . . . . . . . . . 39
Watchdog timer . . . . . . . . . . . . . . . . . . . . . . . 40
Additional features . . . . . . . . . . . . . . . . . . . . . 40
Software reset . . . . . . . . . . . . . . . . . . . . . . . . 40
Dual data pointers . . . . . . . . . . . . . . . . . . . . . 40
Data EEPROM . . . . . . . . . . . . . . . . . . . . . . . . 41
Flash program memory . . . . . . . . . . . . . . . . . 41
General description . . . . . . . . . . . . . . . . . . . . 41
Features . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 41
continued >>
P89LPC932A1_3
Product data sheet
Rev. 03 — 12 March 2007
© NXP B.V. 2007. All rights reserved.
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